小芯片与LLM时代下的硬件设计与安全：统一分析
评分
72首次将小芯片攻击与LLM驱动EDA安全统一分析，带来跨域安全视角的新信息。
系统梳理架构、逻辑和物理三个层面的威胁与防御，结构清晰但缺少实证评估。
为芯片设计团队和安全研究者提供了可落地的防御思路和评估方向。
论文发布时间契合小芯片和LLM驱动EDA的产业热点期，时效性强。
来自arXiv预印本且未经过同行评审，但作者机构与引用质量具备一定可信度。
基础分 79.5 × T2 信源权重 ×0.9 = 72
精选线 70已入选精选
精选理由
前瞻性地将两个前沿领域的安全问题统一梳理，系统性强且路线明确，具有高参考价值。
AI 点评
「这篇论文把两个当下最热的硬件话题——小芯片和LLM驱动的EDA——放在同一个安全框架里，视角很少见。对芯片设计团队来说，最值得关注的是2.5D拆分制造加有源中介层的信任根方案；对AI安全研究者而言，LLM驱动EDA管线的原生威胁也值得警惕。」
速览
该论文提出首个统一框架，分析异构2.5D小芯片系统与LLM驱动EDA带来的安全威胁，涵盖架构、逻辑和物理层攻击，并梳理2.5D拆分制造与有源中介层实现物理隔离信任根、以及LLM驱动EDA管道防护等防御技术，最后探讨LLM系统如何助推小芯片安全。
- 统一分析小芯片系统在架构、逻辑、物理层面的攻击面，包括针对LLM加速硬件栈的攻击。
- 提出用2.5D拆分制造与有源中介层构建物理隔离信任根以防护小芯片系统。
- 分析LLM驱动EDA管道的原生威胁及现有防御技术。
- 讨论LLM系统如何反过来增强小芯片等现代系统的硬件安全。
正文
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